同步时序逻辑电路设计的步骤

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时序电路设计又称为时序电路综合，它是时序电路分析的逆过程，即根据给定的逻辑功能要求，选择适当的逻辑器件，设计出符合要求的时序逻辑电路。本文介绍用触发器及门电路设计同步时序逻辑电路的方法，这种设计方法的基本指导思想是使用尽可能少的时钟触发器和门电路来实现待设计的...