脉冲异步时序逻辑电路的设计

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脉冲异步时序逻辑电路的设计方法与同步时序逻辑电路基本相同，设计过程中主要注意如下几点：　　① 当采用时钟控制触发器作为存储元件时，由于触发器的时钟端被作为激励函数处理，从而使激励函数的确定变得更加灵活。通常根据状态转移要求，恰当地对触发器时钟端和输入端进行处理，...